Главная страница
Навигация по странице:

  • Собрать схему асинхронного RS -триггера в текстовом редакторе. Для этого воспользоваться кодом из приложения.

  • Изучить схему, реализованную в RTL - Viewer .

  • Запрограммировать в отладочную плату. Тип ПЛИС – Altera Cyclone IV E EP 4 CE 22 F 17 C 6. Указать входные сигналы на

  • Собрать схему асинхронного DL -триггера в текстовом редакторе. Для этого воспользоваться кодом из приложения.

  • Построить временные диаграммы, иллюстрирующие работу устройства

  • Отчет по лабораторной работе 3 по дисциплине Цифровая электроника


    Скачать 0.55 Mb.
    НазваниеОтчет по лабораторной работе 3 по дисциплине Цифровая электроника
    Дата31.03.2023
    Размер0.55 Mb.
    Формат файлаdocx
    Имя файлаotchyot_po_tsifre_3.docx
    ТипОтчет
    #1029022

    МИНОБРНАУКИ РОССИИ

    Санкт-Петербургский государственный

    электротехнический университет

    «ЛЭТИ» им. В.И. Ульянова (Ленина)

    Кафедра РС

    отчет

    по лабораторной работе №3

    по дисциплине «Цифровая электроника»

    Вариант 5

    Студент гр. 1404




    Сухов Ю.П.

    Преподаватель




    Богданов Д. В.


    Санкт-Петербург

    2023

    1. Собрать схему асинхронного RS-триггера в текстовом редакторе. Для этого воспользоваться кодом из приложения.



    Рис. 1 – код для RS-триггера

    Изучить схему, реализованную в RTL-Viewer.



    Рис. 2 – схема в RTL-Viewer

    Построить временные диаграммы, иллюстрирующие работу устройства



    Рис. 3 – временная диаграмма с задержкой RS-триннера

    Запрограммировать в отладочную плату. Тип ПЛИС – Altera Cyclone IV E EP4CE22F17C6. Указать входные сигналы на SW1(set), SW5(reset), выходной – на LED3.



    Рис. 4 – PinPlanner RS-триггера

    1. Собрать схему асинхронного DL-триггера в текстовом редакторе. Для этого воспользоваться кодом из приложения.



    Рис. 5 – код для DL-триггера

    Изучить схему, реализованную в RTL-Viewer.



    Рис. 6 – схема в RTL-Viewer

    Построить временные диаграммы, иллюстрирующие работу устройства



    Рис. 7 – временная с задержкой диаграмма DL-триггера

    Запрограммировать в отладочную плату. Тип ПЛИС – Altera Cyclone IV E EP4CE22F17C6. Указать входные сигналы на SW4(data), SW7(load), выходной – на LED4.



    Рис. 8 – PinPlanner DL-триггера

    Вывод: в ходе данной лабораторной работы были изучены RS и DL триггеры, построены временные диаграммы с задержкой и зашит в плату код для каждого триггера.

    RS-триггер сбрасывает значение если вход reset принимает значение 1 и возвращает входное значение если единице равняется set.

    DL-триггер сохраняет значение data, если load равен единице, и не даёт его изменить если load равен нулю.


    написать администратору сайта